低延时 - 电子工程专辑

低延时

GenAI浪潮下智能硬件如何实现低延时AI语音交互

本文来源：声网在 GenAI 的浪潮下，各行各业正迎来全新的变革，作为 AI 载体的智能硬件行业也不例外，一方面，AIGC 与机器人的结合，推动具身智能产业快速发展，科幻电影里善解人意的清扫机器人“瓦力”、医疗机器人“大白”正在走进现实。另一方面，以智能手表、智能眼镜、智能耳机为首的穿戴式智能硬件与多模态大模型的结合也成为当下的新趋势。在2017年以天猫精灵、小爱同学、小度等语音助手驱动的智能设

物联传媒 2024-10-12 727浏览
高带宽低延时远程flash访问架构

ReFlex - Remote Flash ≈ Local Flash一种提供高带宽低延时和多租户场景下可保证的服务质量的远程flash访问架构一、背景对NVMe Flash的远程访问实现了数据中心内Flash容量以及IOPS的灵活扩展和高利用率。但是，现有的用于远程Flash访问的系统会带来巨大的性能开销，或者无法隔离共享每个Flash设备的多个远程clients。二、问题与挑战

SSDFans 2023-10-20 834浏览
基于FPGA的低成本、低延时成像系统

基于 FPGA 的低成本、低延时成像系统副标题：优秀的IC/FPGA开源项目(三)-低成本、低延时成像系统《优秀的IC/FPGA开源项目》是新开的系列，旨在介绍单一项目，会比《优秀的 Verilog/FPGA开源项目》内容介绍更加详细，包括但不限于综合、上板测试等。两者相辅相成，互补互充~目前商用领域的成像系统还是以嵌入式ASIC为主（成品时间快，性价比高），对于一些军工、医学等特殊领域还是以FP

FPGA技术江湖 2023-04-23 1097浏览
PCIe5.0和CXL最大吞吐量和最低延时设计

PCIe5.0和CXL最大吞吐量和最低延时设计围绕数据中心推动新的设计起点和创新，随着大数据集应用推动PCIe 5.0的采用，与此同时， AI/ML和其他数据应用的大小驱动了新的接口需求，Synopsys高性能计算的完整解决方案通过PCIe 5.0与CXL 2.0 技术提供32 GT/s吞吐率，Synopsys解决方案成功完成1GHz时序收敛，CXL内存共享，在CXL解决方案中实现低延迟。全文下载

智能计算芯世界 2021-05-27 3960浏览
【工程师分享】ZCU106在PLDDR实现超低延时编码

作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛 Xilinx提供超低延时编解码方案，在ZCU106单板上可以验证。文档MPSoC VCU TRD 2020.2 Low Latency XV20 提供了详细命令。缺省情况下，编码使用的是PS DDR。如果PS DDR已经被其它应用占用，也可以让编码使用的PL DDR。在VCU T

FPGA开发圈 2021-04-29 1502浏览
【工程师分享】ZCU106的超低延时gstreamer编解码命令

作者：付汉杰，hankf@xilinx.com 文章转载自：赛灵思中文社区论坛 Xilinx提供超低延时编解码方案，在ZCU106单板上可以验证。文档MPSoC VCU TRD 2020.2 Low L

FPGA开发圈 2021-04-27 1526浏览
基于FPGA的超低延时硬件加速行情解析系统

摘要：对于瞬息万变的证券交易市场，即时的行情信息是行情系统的基础。快速获取行情信息可以给市场参与者提供更宽裕的交易决策时间窗口，交易者获取的行情信息延时越低，往往意味着越多的交易机会和越大的决策空间。传统的基于软件的行情信息系统，信息的解析一般经过网络层数据获取、协议层数据解析、应用层数据处理等过程，在操作系统和协议层面，存在毫秒级别的上下文切换和软件处理延时，由于操作系统的进程调度和CPU主频的

网络交换FPGA 2021-03-13 1959浏览

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