Vitis - 电子工程专辑

Vitis

Vitis中的Libraries新功能

作者：Chen Yang，AMD工程师；来源：AMD 开发者社区Vitis 2023.2是Vitis开发工具变化较大的一个版本，设计流程和界面发生了变化。今天介绍一下Vitis New IDE的一个新功能。在过去，Vitis使用Vitis Libraries中的库进行开发的时候，会存在移植困难，IDE支持有限的问题，导致用户处于一个尴尬的境地。针对这一问题，Vitis New IDE做了哪些变化呢

FPGA开发圈 2024-05-28 622浏览
AI引擎系列6-在Vitis分析器中分析AI引擎编译结果（2022.1更新）

作者：Florentw，AMD工程师；来源：AMD开发者社区简介在上一篇 AI 引擎系列博文中，我们运行了 AI 引擎编译器，将计算图 (graph) 与内核代码编译到目标 AI 引擎模型中。在本文中，我们将在 Vitis™ 分析器中详解编译汇总文件，其中提供了有关编译的大量实用信息。要求下文要求您通读前几篇 AI 引擎系列博文。AI 引擎系列 1 - 从 AI 引擎工具开始（2022.1 更新)

FPGA开发圈 2023-12-29 607浏览
10点开讲！AMD资深战略应用工程师教你如何利用编译器指令提升Vitis™HLS设计性能

AMD Vitis™ 高层次综合 ( HLS ) 已成为自适应 SoC 及 FPGA 产品设计领域的一项颠覆性技术，可在创建定制硬件设计时实现更高层次的抽象并提高生产力。Vitis HLS 通过将 C/C++ 代码为 AMD 设备上可编程逻辑的 RTL 代码加速 IP 创建。在 Vitis HLS 中，优化指令脱颖而出成为最强大的工具之一，使设计人员能够从相同底层 C 模型出发，探索各种架构解决方

FPGA开发圈 2023-12-21 694浏览
研讨会回放｜使用Vitis™软件平台开始AI引擎开发

2023年9月27日-10月11日 AMD 举行了系列研讨会｜使用 Vitis™ 统一软件平台加速设计应用。第一讲的主题为“使用 Vitis™ 软件平台开始 AI 引擎开发”，解释革命性的 AI 引擎架构的 AIE 和 AIE-ML 变体，并回顾 Vitis Unified IDE 提供的新工具流和方法论，以开发基于新技术的应用程序，您可点击下方视频观看中文视频。本系列研讨会的另外两场主题的研讨

FPGA开发圈 2023-11-14 622浏览
Vitis库流程：视觉L1重映射函数Zynqbaremetal设计实例

本文作者：AMD 高级产品应用工程师 Kevin Morris这篇博客展示了在 AMD Zynq 设计中，如何用 Vitis Vision Library 中的函数（remap）导出一个 IP，并基于此 IP 构建一个的硬件平台（XSA），进而基于此平台来运行嵌入式应用。remap 函数是指从图像的某个位置获取像素信息，并将这些像素信息重新放置到另一个图像的另一个位置。在此示例中，设计将使用 1

FPGA技术江湖 2023-08-25 847浏览
Vitis库流程-在Zynq裸机设计中使用视觉库L1remap函数的示例

简介本篇博文旨在演示如何在 Zynq 设计中使用 Vitis 视觉库函数 (remap) 作为 HLS IP，然后在 Vitis 中使用该函数作为平台来运行嵌入式应用。remap 函数会从图像中某一处提取像素，并将其重新放置到另一张图像中的某一处位置。在此示例中，本设计将使用一张 128x128 像素的灰阶输入图像，在输出上将其水平翻转。此操作已在如下设置中经过测试：版本：Vivado 和 Vit

FPGA开发圈 2023-07-31 762浏览
Vitis统一软件平台文档：应用加速开发

AMD Vitis™ 统一软件平台是面向异构应用的开发环境，这些应用支持各种 AMD 器件，如 AMD Alveo™ 数据中心加速器卡、AMD Versal™ 自适应 SoC 器件、AMD Kria™ SOM 和 AMD Zynq™ MPSoC。在 Vitis 环境内，异构系统包含在 x86 主机处理器或 Arm® 嵌入式处理器上运行的软件应用、在可编程逻辑（ PL ）区域或 Versal AI

FPGA开发圈 2023-07-19 1279浏览
Vitis™AI3.5现已发布

Vitis™ AI 平台是为 AMD 器件、板卡及 Alveo™ 数据中心加速卡提供的一款综合 AI 推断开发平台。它包括一系列丰富的 AI 模型、优化的深度学习处理器单元 (DPU) 内核、工具、库与示例设计，可充分满足边缘和数据中心的 AI 需求。Vitis AI 以高效易用为设计理念，可在 AMD FPGA 和自适应 SoC 上充分发挥人工智能加速的潜力。本文将介绍 Vitis AI 3.5

FPGA开发圈 2023-07-14 742浏览
开发者分享｜Vitis库流程：视觉L1重映射函数Zynqbaremetal设计实例

本文作者：AMD 高级产品应用工程师 Kevin Morris这篇博客展示了在 AMD Zynq 设计中，如何用 Vitis Vision Library 中的函数（remap）导出一个 IP，并基于此 IP 构建一个的硬件平台（XSA），进而基于此平台来运行嵌入式应用。remap 函数是指从图像的某个位置获取像素信息，并将这些像素信息重新放置到另一个图像的另一个位置。在此示例中，设计将使用 1

FPGA开发圈 2023-07-07 1056浏览
Vitis™ModelComposer2023.1现已更新！

概述Vitis Model Composer 概述Vitis™ Model Composer 是一个基于模型的设计工具，不仅可在 MathWorks MATLAB® 和 Simulink® 环境中进行快速设计探索，而且还可通过自动代码生成在 AMD 器件上加速投产进程。您可以设计您的 DSP 算法并使用高层次性能优化模块对其进行迭代，同时还可通过系统级仿真验证功能正确性。Vitis Model C

FPGA开发圈 2023-05-31 1108浏览
Vitis™统一软件平台2023.1全新发布

AMD Vitis™ 统一软件平台 2023.1 版近期已正式发布！主要增强特性包括下列内容：版本亮点Versal™ AI 引擎 (AIE) 阵列的最新 Vitis™ 库函数DSP 库函数 — 更多 FIR 过滤器配置求解器库函数 — 功能增强，性能提升Versal AI Core 和 AI Edge 系列的设计流程增强为作为输入/输出的 2D 及 3D 阵列提供 AIE 编译器支持为 FIFO

FPGA开发圈 2023-05-24 1209浏览
在Vitis中通过PSUDDR执行MicroBlaze应用

作者：stephenm，AMD Xilinx工程师文章来源：AMD Xilinx开发者社区MicroBlaze™ CPU 是可修改的拖入式预设 32 位/64 位 RISC 微处理器配置系列。MicroBlaze 处理器能满足众多多样化的应用程序的不同需求，惠及工业、医疗、汽车、消费品和通信市场。MicroBlaze 使用哈佛 (Harvard) 架构，此架构的 PL 内通常包含双 LMB BRA

FPGA开发圈 2023-05-12 984浏览
Vitis嵌入式Linux:Sysroot和库的用法

作者：Ibaie，AMD开发工程师以下博文演示了在Vitis™ 中对 Linux 应用程序开发的过程中如何使用外部库。我将使用由 libxml2 库所提供的“Parse and validate an XML file with an xmlReader” 应用示例来演示本示例，并且和基于 ZCU102 开发板的 PetaLinux BSP 编译出来的 Linux 镜像相关联。01创建 Linux

FPGA开发圈 2023-04-10 1046浏览
Vitis™库通过搭载AI引擎的Versal™器件为优质医学成像提速

尽管超声波技术能提供显著优势，但医疗设备制造商正发现，要想继续提升成像质量和精准性仍是一大挑战。有鉴于串行数据采集、可移植性有限、低帧率（每秒 10 到 50 帧）和影像聚焦欠佳（只能在单一深度上聚焦）等挑战，当今医学影像工具在实时运用方面的能力仍然有限。一位护士在查看超声影像为了向医疗机构及其患者提供更优异的成像系统性能，我们宣布推出首批医学影像库（ medical imaging librar

FPGA开发圈 2023-01-10 846浏览
Vitis™统一软件平台2022.2最新更新

本文由 AMD 赛灵思 Vitis 统一软件平台产品营销经理 Eddie Wu 撰写Vitis™ 统一软件平台 2022.2 版已正式发布！主要增强特性包括下列内容：为 Versal AI 引擎阵列提供新的 Vitis 库功能：DSP 库 - 增强特性。求解器库功能。视觉库功能。超声库功能。针对 Versal 器件的设计流程增强：控制内核在 AI 引擎阵列中的相对布局，从而提升性能，提高利用率。强

FPGA开发圈 2022-11-04 1351浏览
Vitis视觉AI引擎(AIE)的设计方法

Vitis 视觉 AIE 设计方法有助于设计人员利用 Vitis 视觉 AIE 库的功能，该功能主要针对 Versal 自适应计算加速平台 (ACAP)。这包括创建自适应数据流 (ADF) 图形、设置虚拟平台以及编写相应的主机代码等。如欲了解有关该工作流程所涉及到的步骤的更多详细信息，请点击“阅读原文”或扫码参阅 Vitis AIE 设计方法。

FPGA开发圈 2022-10-08 1077浏览
工程师必看！Vitis视觉设计方法

Vitis 视觉库可用于通过 Vitis 设计方法在 Vitis HLS 中构建应用，该方法不仅可帮助开发人员做出有关应用架构的重要决策，而且还有助于确定各种因素，例如什么软件功能应该映射至处理内核、需要多大的并行度，以及将其目标确定为可编程逻辑的方法，以加速新一代计算机视觉或图像处理应用，等等。如欲了解有关该工作流程所涉及到的步骤的更多详细信息，请扫码或点击“阅读原文”参阅 Vitis 设计方法

FPGA开发圈 2022-09-28 827浏览
Vitis高层次综合用户指南

Vitis™ HLS 是一种高层次综合工具，支持将 C、C++ 和 OpenCL™ 函数硬连线到器件逻辑互连结构和 RAM/DSP 块上。Vitis HLS 可在Vitis 应用加速开发流程中实现硬件内核，并使用 C/C++ 语言代码在 Vivado® Design Suite 中为赛灵思器件设计开发 RTL IP。Vitis 高层次综合用户指南（UG1399）包括Vitis HLS 入门、Vit

FPGA开发圈 2022-06-24 1315浏览
Vitis嵌入式平台创建所需要注意的问题

更多详情，请点击“阅读原文”或扫描二维码

FPGA开发圈 2022-05-23 957浏览
使用Vitis软件平台进行调试

本章描述了对您所执行的设计流程可能出现的各种问题进行调试的方法。第一个选项是使用赛灵思 Vitis™ 软件平台进行调试。Vitis 软件平台调试器提供了下列调试功能：支持在 Arm® Cortex™-A72、Arm Cortex-R5F 和 MicroBlaze™ 处理器架构（异构多处理器硬件系统调试）上调试程序。支持在硬件开发板上调试程序。支持在远程硬件系统上进行调试。提供功能丰富的 IDE 用

FPGA开发圈 2022-04-26 6770浏览
Vitis视觉库的OpenCV安装指南

Vitis视觉库是一个FPGA加速视觉功能的集合，类似于OpenCV中的功能。虽然这些内核的实现并不依赖于OpenCV，但许多视觉库的功能都提供了示例设计测试平台，使用OpenCV来演示加速内核的功能。OpenCV 库安装可能非常复杂，具体取决于系统的性质。虽然赛灵思不支持使用Vitis HLS和Vitis Accelerated Libraries开发时安装OpenCV的具体方法，本文提供了几个

FPGA开发圈 2022-03-14 1674浏览
手把手教你在Windows下用WSL运行Vitis/Vivado/Petalinux

想在Windows下完成Xilinx基于Linux的整套开发编译链？觉得虚拟机还是有各种不便？使用WSL2的时候遇到了各种问题？欢迎联系科通，科通Xilinx技术Team帮您踩坑。为什么现在是开始利用WSL运行Xilinx设计链的好时机？Windows Subsystem for Linux（简称WSL）是一个在Windows 10上能够运行原生Linux二进制可执行文件（ELF格式）的兼容层。它

FPGA开发圈 2022-02-10 4211浏览
Vitis高级综合用户指南(v2021.2)

简介本文描述如何使用 Vitis™ 高级综合工具。识别二维码立即在线下载

FPGA开发圈 2022-01-04 1141浏览
开发者分享|Vitis_HLS,玩转AXI总线突发读写的代码风格-上

本文作者：赛灵思产品应用工程师 Wen Chen在Vitis HLS 工具中，要真正完成AXI总线突发，我们需要一个合适的代码风格并结合恰当的指令设置来达到这个目的。本章节带大家看看如何玩转AXI总线突发读写的代码风格-上。  突发读写的HLS 代码风格优化：HLS编译器所能识别的突发读写有顺序突发(sequential burst) 和流水线突发(Pipeline burst)，一般来说流水线突

FPGA开发圈 2021-12-27 1551浏览
\下午13:30直播：赛灵思线上技术大会Vitis及VitisAI专场

11月30日-12月7日赛灵思线上技术大会Xilinx Adapt - 中国站将迎来“开发者系列”专场活动！今天下午13:30 Vitis 及 Vitis AI 专场直播！此外12月7日 Vitis 及 Vitis AI 会有下半场直播，可以提前预约名欢迎报名观看Vitis 及 Vitis AI软件开发者可利用前者构建软件可调用加速器，后者则可以帮助数据科学家用来加速 AI 推断。点击下图报名 X

EETOP 2021-12-07 1114浏览

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