PCIe - 电子工程专辑

PCIe

PCIE工程bd上ddr3和xdmaip核通过axiconnect.互联，数据怎么交互?

大侠好，欢迎来到FPGA技术江湖，江湖偌大，相见即是缘分。大侠可以关注FPGA技术江湖，在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源，或者一起煮酒言欢。“煮酒言欢”进入IC技术圈，这里有近100个IC技术公众号。今天给大侠带来在FPAG技术交流群里平时讨论的问题答疑合集（二十八），以后还会多推出本系列，话不多说，上货。FPGA技术交流群目前已有十多个群，QQ和微信均覆盖，人数达数万人，有需

FPGA技术江湖 2024-10-25 247浏览
强烈推荐一款查看Windows下设备信息的软件！USB/PCIE一览无余！

点击左上方蓝色“一口Linux”，选择“设为星标”第一时间看干货文章 ☞【干货】嵌入式驱动工程师学习路线☞【干货】Linux嵌入式知识点-思维导图-免费获取☞【就业】一个可以写到简历的基于Linux物联网综合项目☞【就业】找工作简历模版在linux系统中，我们要查看硬件信息，通常通过lspci、lsusb、top、vmstat、free、iostat 等命令，或者/proc/cpuinfo、/p

一口Linux 2024-10-24 597浏览
将Microchip的PCI/PCIe®总线卡与NTPd配合使用

点击蓝字关注我们Microchip于近期发布了一份应用笔记，详细介绍如何将我们的PCI/PCIe®总线级计时卡与NTP Daemon集成。此应用允许在安装了Microchip PCI/PCIe 总线卡的 Linux® 计算机上精确控制本地时钟。扫码浏览相关页面请阅读原文下载该应用笔记。

Microchip微芯 2024-10-11 275浏览
如何调试PCIE中ATS失效消息

作者：Yang Iris，AMD工程师；来源：AMD开发者社区概述本文提供了针对 PCIe 系统中 ATS（地址翻译服务）失效消息问题（ATS Invalidation message）的排查指南，特别是主机发送消息但未在 CQ接口中接收到消息的情况。ATS 失效消息的使用ATS（地址翻译服务）失效消息（ ATS invalidation message）对于管理支持 ATS 的 PCIe 系统

FPGA开发圈 2024-10-11 344浏览
国产PCIe接口芯片三连发，带你一探背后奥秘

【引言】今年9月，电科星拓在其官方公众号上连续发布了三款国产PCIe接口芯片，涵盖PCIe Retimer芯片、PCIe 转SATA芯片和PCIe转USB芯片，合计推出7个型号。这一系列新品的发布，意味着国产PCIe接口芯片再添新军，这背后还透露出芯片厂商什么样的战略意图？对市场有哪些影响？【PCIe接口芯片简述】众所周知，PCIe接口芯片在现代数据传输和计算中起着至关重要的作用。PCIe接口芯片

智能计算芯世界 2024-09-29 1011浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-09-24 453浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-09-02 446浏览
了解光纤传输PCIe

作者：技术产品管理部 Keivan Javadi Khasraghi 和 Ruben Sousa数据中心目前正在努力应对不断增长的带宽容量需求。这主要是由于新技术的出现，特别是对 AI/ML 应用的需求不断增长。随着这些技术的发展，带宽需求预计将呈指数级增长。具体来说，随着大语言模型 (LLM) 变得更加精确和广泛，它们需要越来越高的处理速度。这种对于快速处理 LLM 模型的需求激增，凸显了数据中

FPGA开发圈 2024-08-28 546浏览
基于标准PCIe接口的人工智能加速卡液冷设计指南

本文来自“基于标准PCIe接口的人工智能加速卡液冷设计白皮书（2024）”，液冷技术成为解决人工智能服务器高功耗散热问题、降低数据中心PUE的关键，其中冷板式液冷技术是当前解决人工智能加速卡高功耗问题的主流方案。目前标准PCIe接口形态的人工智能加速卡仍然是业界主流，国内外部分厂商已经推出了相应的冷板式人工智能加速卡，但均是按照自身产品形态特征进行设计，未考虑同行业其他厂商情况，不能作为标准化设计

智能计算芯世界 2024-08-21 532浏览
全液冷服务器CPU、内存、PCIe等关键部件设计

本文来自“全液冷冷板系统参考设计及性能测试白皮书（2024）”，除了目前广泛尝试的CPU和GPU液冷外，对高功耗内存，固态硬盘，OCP网卡，PSU电源，PCIe和光模块液冷也进行了深入的探索和研究，打造行业最高液冷覆盖率，满足用户多种液冷覆盖占比部署要求。相关链接：全液冷冷板系统参考设计及性能测试白皮书（2024）基于标准PCIe接口的人工智能加速卡液冷设计白皮书（2024）《服务器及存储用液冷部

智能计算芯世界 2024-08-19 639浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-08-09 547浏览
Microchip推出高性能第五代PCIe®固态硬盘控制器系列

人工智能（AI）的蓬勃发展和云服务的快速普及正推动对更强大、更高效和更可靠的数据中心的需求。为满足日益增长的市场需求，Microchip Technology（微芯科技公司）推出Flashtec® NVMe® 5016固态硬盘（SSD）控制器。这款16通道第五代PCIe® NVM Express®（NVMe）控制器旨在提供更高的带宽、安全性和灵活性。Microchip 负责数据中心解决方案业务

Microchip微芯 2024-08-06 542浏览
PCIe四种地址空间介绍

PCIe架构定义了4种地址空间：配置空间、Memory空间、IO空间和message空间。1. 配置空间每个PCIe Function都有4KB的配置空间(Configuration Space)。前256 Bytes是和PCI兼容的配置空间，剩余的是PCIe扩展配置空间(Extended Configuration Space)。PCIe配置空间如下图所示，地址范围为0x000～0xfff。软件

路科验证 2024-08-06 914浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-08-05 465浏览
PCIe设备深入及系统性能优化第三期招生

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Linux阅码场 2024-08-04 469浏览
PCIe总线4种复位介绍

PCIe规范定义了四种类型的复位：冷复位、暖复位、热复位和FLR复位（Function Level Reset）。前三个是PCIe规范早期版本就已经定义的，称为传统复位（Conventional Reset）。随着PCIe 2.0规范修订而增加的Function Level Reset称为功能级复位。1. 传统复位（Conventional Reset）传统复位包括Cold Reset、Warm

路科验证 2024-08-01 759浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-07-31 424浏览
PCIe的基础分析和测试实例

PCIe的介绍 PCI Express Standards Development 1.1.2PCIe gen4 TX test 1.1.3PCIe gen4 RX test

启芯硬件 2024-07-29 546浏览
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Linux阅码场 2024-07-29 498浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-07-25 517浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-07-24 534浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-07-20 542浏览
如何使用配置管理接口配置PCIE的配置空间

作者：Meng Fancheng，AMD工程师；来源：AMD开发者社区Mgmt（Configuration Management Interface）接口简介配置管理接口可用于客户对PCIE的配置空间进行读写，本篇blog主要介绍配置管理接口的使用方法及其验证。cfg_mgmt_addr是读写PCIe配置空间的地址，此输入的地址是实际要访问的地址除以4，例如下图1的中的Command寄存器的地址为

FPGA开发圈 2024-07-16 582浏览
PCIe扩展GPUVRAM容量新技术—实现两位数纳秒延迟！

用于 AI 和 HPC 应用的现代 GPU 内置了有限数量的高带宽内存（HBM），限制了它们在 AI 和其他工作负载中的性能。然而，新技术将允许GPU通过与连接到PCIe总线的设备插入更多内存来扩展GPU内存容量，而不是局限于GPU内置的内存 - 它甚至允许使用SSD进行内存容量扩展。Panmnesia 是一家由韩国著名的 KAIST 研究所支持的公司，它开发了一种低延迟的 CXL IP，可用于

EETOP 2024-07-03 576浏览
PCIe设备深入及系统性能优化第三期招生

课程背景CPU, GPU, DPU并称为数据中心的三大核心芯片。近些年，随着公有云和AI训练集群的火爆，以DPU(SmartNIC), AI芯片等为代表的PCIe 加速设备走到了台前。人们也日渐意识到，PCIe互连性能已经成为系统性能瓶颈。对于异构加速方向的驱动工程师，系统工程师，异构硬件架构/设计人员，需要系统地掌握和理解PCIe协议，PCIe系统，才能应对工作中复杂的问题定位和性能调优工作。课

Linux阅码场 2024-06-17 585浏览

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