芯片设计小经验 - 电子工程专辑

芯片设计小经验

芯片设计小经验——可配置性/可拓展性

Hello 大家好，这篇文章想聊一下设计中一个比较常见的需求——多版本交付。如果你是一位IP设计者，经常会遇到这个问题，不同的需求方对同一IP的特性和性能有不同的要求。很明显对于不同的需求都维护一套完全不同的代码交付是不现实的，通常的做法都是同一套代码中利用好模块化，参数化来实现多个功能，性能，功耗，面积的灵活可变。因此在最开始制定方案的时候，如果知道设计今后可能会需要有多版本交付需求，就要考虑做

数字IC自修室 2021-08-25 2944浏览
芯片设计小经验——大道至简

作为一个IC前端设计工程师，每个人都想追求极致的PPA，以及电路的鲁棒性。在各种微架构之间权衡，PK，tradeoff，为了实现PPA最优，或者某个单项最优，常常需要绞尽脑汁。而在进行验证时，也是需要极尽思考，避免各种可能的corner场景，保证验证的完备。而所谓大道至简，在电路设计中很多时候简单的就是最好的。简洁意味着更少的资源，更低的功耗，容易实现更高的频率，自然也就提高了PPA。此外，简洁还

数字IC自修室 2021-08-25 2001浏览
芯片设计小经验——写RTL也要考虑后端物理实现

我们知道，IC设计是环环紧扣的。虽然流程上分前端后端，工种上分写代码的，做物理实现的（大部分公司如此划分），但是归根到底做的都是同一个产品。因此，前端设计工程师涉猎后端物理实现的知识，物理实现工程师了解前端设计具体的功能，无疑能够更好地提高整个设计流程的效率和质量。这篇文章简单罗列两个前端工程师在做RTL设计时需要考虑到的除了PPA之外的物理实现方面的点。 1 模块设计时

数字IC自修室 2021-08-25 4478浏览
芯片设计小经验——寄存器的不同verilog描述

我们知道对于每个IC前端工程师来说，一个好的代码风格很重要，一方面便于保证自己书写时硬件逻辑脉络的清晰，另外一个更重要的原因是便于代码的阅读和维护。这篇文章想聊一下RTL里描述寄存器的两种不同代码风格。对于寄存器来说，分为控制寄存器和数据寄存器。一般而言数据寄存器不需要复位，bit数也较大。在描述的时候略为不同。很明显，这种方式描

数字IC自修室 2021-08-20 3550浏览
芯片设计小经验——流水线设计

pipeline流水线设计是一种典型的面积换性能的设计。一方面通过对长功能路径的合理划分，在同一时间内同时并行多个该功能请求，大大提高了某个功能的吞吐率；另一方面由于长功能路径被切割成短路径，可以达到更高的工作频率，如果不需要提高工作频率，多出来的提频空间可以用于降压降功耗，进可攻退可守。今天这篇文章将小小总结一下流水线设计的一些关键点。 1 流水线的时间

数字IC自修室 2021-08-20 4974浏览
芯片设计小经验——异步电路跨时钟域小结

大家好，我是L.L.，欢迎来到数字ic自修室。今天的主题是异步电路的跨时钟域处理。首先需要强调的是，本文提到的异步电路，指的是由没有特定相位关系的时钟驱动的同步系统之间的交互。除此之外，还有一种比较小众的设计也叫异步电路设计，该设计的系统是没有任何全局时钟驱动的，信号的传输都是基于握手完成。此类设计不在本文讨论范围之内，后续会有另外的文章介绍。关于异步电路，是面试里被问的最多的部分，

数字IC自修室 2021-08-20 4236浏览

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