一前言
EMC整改过程中,时钟问题是我们经常遇到的EMC难题之一,在前期设计中重点关注并做好相应的处理措施,肯定是最优解的。但是如果前期设计没有注意或者结构原因没办法做最优处理,该怎么办呢?这也是一直困扰很多工程师的问题,处理的手段也没有太多,还得考虑信号完整性。今天给大家分享一个简洁的时钟问题处理方案。
二整改案例
摸底数据-水平方向图(1)
加入展频IC的PCB电路图(3)
整改后测试数据-垂直方向图(6)
可以看出整体的测试数据有了明显的减低,高频超标的时钟噪声也有了6dB的余量。
三总结
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