输入的电压信号经耦合电路后送至前端放大器，前端放大器将信号放大，以提高示波器的灵敏度和动态范围。放大器输出的信号由取样/保持电路进行取样，并由 A/D 转换器数字化，经过 A/D 转换后，信号变成了数字形式存入存储器中，微处理器对存储器中的数字化信号波形进行相应的处理，并显示在显示屏上。这就是数字存储示波器的工作过程。
我们知道，计算机只能处理离散的数字信号。在模拟电压信号进入示波器后面临的首要问题就是连续信号的数字化（模/数转化）问题。一般把从连续信号到离散信号的过程叫采样（sampling）。连续信号必须经过采样和量化才能被计算机处理，因此，采样是数字示波器作波形运算和分析的基础。通过测量等时间间隔波形的电压幅值，并把该电压转化为用八位二进制代码表示的数字信息，这就是数字存储示波器的采样。采样电压之间的时间间隔越小，那么重建出来的波形就越接近原始信号。采样率（sampling rate）就是采样时间间隔。比如，如果示波器的采样率是每秒10G次（10GSa/s），则意味着每100ps进行一次采样。
根据Nyquist采样定理，当对一个最高频率为fmax的带限信号进行采样时，采样频率SF必须大于fmax的两倍以上才能确保从采样值完全重构原来的信号。这里，fmax 称为Nyquist频率，2fmax 为Nyquist采样率。对于正弦波，每个周期至少需要两次以上的采样才能保证数字化后的脉冲序列能较为准确的还原原始波形。如果采样率低于Nyquist采样率则会导致混叠（Aliasing）现象。
下图显示的波形看上去非常相似，但是频率测量的结果却相差很大，究竟哪一个是正确的？
仔细观察我们会发现左图中触发位置和触发电平没有对应起来，而且采样率只有250MS/s，右图中使用了20GS/s的采样率。可以确定，左图显示的波形欺骗了我们。这即是一例采样率过低导致的混叠（Aliasing）给我们造成的假象。
因此在实际测量中，对于较高频的信号，工程师的眼睛应该时刻盯着示波器的采样率，防止混叠的风险。我们建议工程师在开始测量前先固定示波器的采样率，这样就避免了欠采样。力科示波器的时基（TimeBase）菜单里提供了这个选项，可以方便的设置。
由Nyquist定理我们知道对于最大采样率为10GS/s的示波器，可以测到的最高频率为5GHz，即采样率的一半，这就是示波器的数字带宽，而这个带宽是DSO的上限频率，实际带宽是不可能达到这个值的，数字带宽是从理论上推导出来的，是DSO带宽的理论值。与我们经常提到的示波器带宽（模拟带宽）是完全不同的两个概念。
那么在实际的数字存储示波器，对特定的带宽，采样率到底选取多大？通常还与示波器所采用的采样模式有关。
当信号进入DSO后，所有的输入信号在对其进行A/D转化前都需要采样，采样技术大体上分为两类：实时模式和等效时间模式。
实时采样（real-time sampling）模式用来捕获非重复性或单次信号，使用固定的时间间隔进行采样。触发一次后，示波器对电压进行连续采样，然后根据采样点重建信号波形。
等效时间采样（equivalent-time sampling）是对周期性波形在不同的周期中进行采样，然后将采样点拼接起来重建波形，为了得到足够多的采样点，需要多次触发。等效时间采样又包括顺序采样和随机重复采样两种。使用等效时间采样模式必须满足两个前提条件：1.波形必须是重复的；2.必须能稳定触发。
实时采样模式下示波器的带宽取决于A/D转化器的最高采样速率和所采用的内插算法。即示波器的实时带宽与DSO采用的A/D和内插算法有关。
实时带宽：实时带宽也称为有效存储带宽，是数字存储示波器采用实时采样方式时所具有的带宽。
DSO的带宽分为模拟带宽和存储带宽。通常我们常说的带宽都是指示波器的模拟带宽，即一般在示波器面板上标称的带宽。而存储带宽也就是根据Nyquist定理计算出来的理论上的数字带宽，这只是个理论值。
通常我们用有效存储带宽（BWa）来表征DSO的实际带宽,其定义为：BWa=最高采样速率/k，最高采样速率对于单次信号来说指其最高实时采样速率，即A/D转化器的最高速率；对于重复信号来说指最高等效采样速率。k称为带宽因子，取决于DSO采用的内插算法。DSO采用的内插算法一般有线性（linear）插值和正弦（sinx/x）插值两种。k在用线性插值时约为10，用正弦内插约为2.5，而k=2.5只适于重现正弦波，对于脉冲波，一般取k=4，此时，具有1GS/s采样率的DSO的有效存储带宽为250MHz。
使用正弦插值法时，为了准确再显信号，示波器的采样速率至少需为信号最高频率成分的2.5倍。使用线性插值法时，示波器的采样速率应至少是信号最高频率成分的10倍。这也解释了示波器用于实时采样时，为什么最大采样率通常是其额定模拟带宽的四倍或以上。
在谈完采样率后，还有一个与DSO的A/D密切相关的概念，就是示波器的垂直分辨率。垂直分辨率决定了DSO所能分辨的最小电压增量，通常用A/D的位数n表示。前面我们提到现在DSO的A/D转换器都是8位编码的，那么示波器的最小量化单位就是1/256，（2的8次方），即0.391%。
对于电压的幅值测量，如果你示波器当前的垂直刻度设置成1v/div的档位，那意味着你的测量值有8V*0.391%=31.25mV以内的误差是正常的。因为小于31.25mV的电压示波器在该档位下已经分辨不出来了，如果只用了4位，那测出来的误差更惊人！所以建议大家在测量波形时，尽可能调整波形让其充满整个屏幕，充分利用8位的分辨率。我们经常听到有工程师抱怨示波器测不准他的电压或者说测量结果不一致，其实大多数情况是工程师还没有理解示波器的垂直分辨率对测量结果的影响。关于示波器的测量精度问题，必须澄清一点——示波器本身就不是计量的仪器，它是“工程师的眼睛”，帮助你更深入的了解你的电路的特征。
下图是用模拟带宽为1GHz的示波器测量上升时间为1ns的脉冲，在不同采样率下测量结果的比较，可以看出：超过带宽5倍以上的采样率提供了良好的测量精度。进一步，根据我们的经验，建议工程师在测量脉冲波时，保证上升沿有5个以上采样点，这样既确保了波形不失真，也提高了测量精度。
提到采样率就不能不提存储深度。对DSO而言，这两个参量是密切相关的。
把经过A/D数字化后的八位二进制波形信息存储到示波器的高速CMOS存储器中，就是示波器的存储，这个过程是“写过程”。存储器的容量（存储深度）是很重要的。对于DSO，其最大存储深度是一定的，但是在实际测试中所使用的存储长度却是可变的。
在存储深度一定的情况下，存储速度越快，存储时间就越短，他们之间是一个反比关系。存储速度等效于采样率，存储时间等效于采样时间，采样时间由示波器的显示窗口所代表的时间决定，所以：
存储深度＝采样率×采样时间（距离=速度×时间）
力科示波器的时基（Time Base）标签即直观的显示了这三者之间的关系，如下图所示。
由于DSO的水平刻度分为10格，每格的所代表的时间长度即为时基（time base），单位是t/div，所以：
采样时间＝time base×10
由以上关系式我们知道，提高示波器的存储深度可以间接提高示波器的采样率：当要测量较长时间的波形时，由于存储深度是固定的，所以只能降低采样率来达到，但这样势必造成波形质量的下降；如果增大存储深度，则可以以更高的采样率来测量，以获取不失真的波形。
下图的曲线充分揭示了采样率、存储深度、采样时间三者的关系及存储深度对示波器实际采样率的影响。比如，当时基选择10us/div档位时，整个示波器窗口的采样时间是10us/div*10格=100us，在1Mpts的存储深度下，当前的实际采样率为：1M÷100us=10Gs/s，如果存储深度只有250K，那当前的实际采样率就只要2.5GS/s了！
存储深度决定了DSO同时分析高频和低频现象的能力，包括低速信号的高频噪声和高速信号的低频调制。
在谈完采样率和存储深度这两个指标的相关理论后，接下来结合常见的应用，我们一起更深入的了解一下这两个参数对我们实际测试的影响。
力科测试测量仪器，优秀文章分享。
由于功率电子的频率相对较低（大部分小于1MHz），对于习惯于用高带宽示波器做高速信号测量的工程师来说，往往有一种错觉，电源测量可能很简单，事实是对于电源测量应用中的示波器选择不少工程师犯了错误。虽然500MHz的示波器带宽相对于几百KHz的电源开关频率来说已经足够，但很多时候我们却忽略了对采样率和存储深度的选择。
比如说在常见的开关电源的测试中，电压开关的频率一般在200KHz或者更快，由于开关信号中经常存在着工频调制，工程师需要捕获工频信号的四分之一周期或者半周期，甚至是多个周期。开关信号的上升时间约为100ns，我们建议为保证精确的重建波形需要在信号的上升沿上有5个以上的采样点，即采样率至少为5/100ns=50MS/s，也就是两个采样点之间的时间间隔要小于100/5=20ns，对于至少捕获一个工频周期的要求，意味着我们需要捕获一段20ms长的波形，这样我们可以计算出来示波器每通道所需的存储深度=20ms/20ns=1Mpts。同样，在分析电源上电的软启动过程中功率器件承受的电压应力的最大值则需要捕获整个上电过程（十几毫秒），所需要的示波器采样率和存储深度甚至更高。
在DSO中，通过快速傅立叶变换（FFT）可以得到信号的频谱，进而在频域对一个信号进行分析。如电源谐波的测量需要用FFT来观察频谱，在高速串行数据的测量中也经常用FFT来分析导致系统失效的噪声和干扰。对于FFT运算来说，示波器可用的采集内存的总量将决定可以观察信号成分的最大范围（奈奎斯特频率），同时存储深度也决定了频率分辨率△f。如果奈奎斯特频率为500MHz，分辨率为10kHz，考虑一下确定观察窗的长度和采集缓冲区的大小。若要获得10kHz的分辨率，则采集时间至少为：T=1/△f=1/10kHz=100ms，对于具有100kB存储器的数字示波器，可以分析的最高频率为：
在下图所示的例子中，266MHz信号受到来自30kHz噪声源的捡拾噪声的影响。FFT（下方的轨迹）显示了以266MHz为中间、相距30kHz的一系列峰值。这种失真十分常见，可能是由于开关式电源、DC-DC转换器或其它来源的串扰导致的。它也可能是由故意使用扩频时钟导致的。
对于DSO来说，长存储能产生更好的FFT结果，既增加了频率分辨率又提高了信号对噪声的比率。另外，针对某些应用，一些非常细节的信息需要在20Mpts的存储深度下才能分析出来，如以下两图所示。
需要指出的是，对于长波形的FFT分析需要示波器超强的数据处理能力，这往往超出了某些示波器的运算极限。力科示波器最大可以做25M点的FFT，在业内是有着较高优势的。
抖动分析和眼图测试已成为分析高速串行链路的重要手段，也成为评估高端示波器的重要参考。
当使用示波器进行抖动测试时，高速采集内存长度是示波器进行抖动测试的关键指标。高速内存长度不仅决定了一次抖动测试中样本数的多少，还决定了示波器能够测试的抖动频率范围。这是因为所有的抖动都具有不同的频率分量，其通常从DC直流到高频部分。示波器单次采集时间窗口的倒数即表明了抖动测试的频律范围。
例如，你用一个具有20G采样/秒(S/s)的采样率和1M采样内存的示波器捕获一个2.5Gbps信号，那么你的示波器屏幕上就能捕捉到50微秒长的一段波形，意味着你能捕获到一个频率为20kHz的低频抖动周期。同样的，对于20GS/s采样率100M存储深度（如力科的SDA6000AXXL），则可以捕获到200Hz的低频抖动周期。
而传统示波器设计时采用将高速采集前端（多达80颗ADC）和高速内存在物理上用一颗SoC芯片实现，由于有太多功能在一个芯片内部，导致片内高速内存容量的限制（在40GS/s下一般小于2M），只能测量到20KHz以上的抖动，并且当需要测试低频抖动时，无法对内存扩展升级。对于大多数应用，测试和分析200Hz到20KHz范围内的抖动信息非常重要。
为了弥补这种设计结构的缺陷，这类示波器会采用外部的低速存储器弥补片内高速内存，但外部存储器不能在高采样率下工作，一般只能提供2GS/s，无法提供有意义的抖动测试结果。例如，当使用40GS/s实时高速采集时，512K内存一次采集数据量仅为12.5us，只能测试频率范围为80K以上的抖动。在各种串行总线和时钟抖动测试中都很难满足测试要求。
在眼图测试中，由于力科率先采用的软件时钟恢复（CDR）技术已成为行业标准，在高速串行总线大行其道的今天，需要示波器有更强的数据处理能力对大量的数据样本做实时的眼图分析。比如，对PCIE-G2等眼图分析都需要一次对1百万个UI的数据进行测量，并非所有厂商的示波器都能像力科示波器一样能对所有捕获到的数据样本做实时的、动态的眼图测量。
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